eda技術(shù)論文
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eda技術(shù)論文范文第1篇
所謂EDA技術(shù)是在電子CAD技術(shù)基礎(chǔ)上發(fā)展起來的計(jì)算機(jī)軟件系統(tǒng)。它是以計(jì)算機(jī)為工作平臺(tái)，以硬件描述語言為系統(tǒng)邏輯描述的主要表達(dá)方式，以EDA工具軟件為開發(fā)環(huán)境，以大規(guī)模可編程邏輯器件PLD(ProgrammableLogicDevice)為設(shè)計(jì)載體，以專用集成電路ASIC(ApplicationSpecificIntegratedCircuit)、單片電子系統(tǒng)SOC(SystemOnaChip)芯片為目標(biāo)器件，以電子系統(tǒng)設(shè)計(jì)為應(yīng)用方向的電子產(chǎn)品自動(dòng)化設(shè)計(jì)過程[J]。在此過程中，設(shè)計(jì)者只需利用硬件描述語言HDL(HardwareDescriptionlanguage)，在EDA工具軟件中完成對系統(tǒng)硬件功能的描述，EDA工具便會(huì)自動(dòng)完成邏輯編譯、化簡、分割、綜合、優(yōu)化、布局、布線和仿真，直至特定目標(biāo)芯片的適配編譯、邏輯映射和編程下載等工作，最終形成集成電子系統(tǒng)或?qū)Ｓ眉尚酒?。盡管目標(biāo)系統(tǒng)是硬件，但整個(gè)設(shè)計(jì)和修改過程如同完成軟件設(shè)計(jì)一樣方便和高效。
現(xiàn)代EDA技術(shù)的基本特征是采用高級語言描述，具有系統(tǒng)級仿真和綜合能力。EDA技術(shù)研究的對象是電子設(shè)計(jì)的全過程，有系統(tǒng)級、電路級和物理級各個(gè)層次的設(shè)計(jì)。EDA技術(shù)研究的范疇相當(dāng)廣泛，從ASIC開發(fā)與應(yīng)用角度看，包含以下子模塊：設(shè)計(jì)輸入子模塊、設(shè)計(jì)數(shù)據(jù)庫子模塊、分析驗(yàn)證子模塊、綜合仿真子模塊和布局布線子模塊等。EDA主要采用并行工程和“自頂向下”的設(shè)計(jì)方法，然后從系統(tǒng)設(shè)計(jì)入手，在頂層進(jìn)行功能方框圖的劃分和結(jié)構(gòu)設(shè)計(jì)，在方框圖一級進(jìn)行仿真、糾錯(cuò)，并用VHDL等硬件描述語言對高層次的系統(tǒng)行為進(jìn)行描述，在系統(tǒng)一級進(jìn)行驗(yàn)證，最后再用邏輯綜合優(yōu)化工具生成具體的門級邏輯電路的網(wǎng)表，其對應(yīng)的物理實(shí)現(xiàn)級可以是印刷電路板或?qū)Ｓ眉呻娐贰?/p>
二、EDA技術(shù)的發(fā)展
EDA技術(shù)的發(fā)展至今經(jīng)歷了三個(gè)階段：電子線路的CAD是EDA發(fā)展的初級階段，是高級EDA系統(tǒng)的重要組成部分。它利用計(jì)算機(jī)的圖形編輯、分析和存儲(chǔ)等能力，協(xié)助工程師設(shè)計(jì)電子系統(tǒng)的電路圖、印制電路板和集成電路板圖。它可以減少設(shè)計(jì)人員的繁瑣重復(fù)勞動(dòng)，但自動(dòng)化程度低，需要人工干預(yù)整個(gè)設(shè)計(jì)過程。
EDA技術(shù)中級階段已具備了設(shè)計(jì)自動(dòng)化的功能。其主要特征是具備了自動(dòng)布局布線和電路的計(jì)算機(jī)仿真、分析和驗(yàn)證功能。其作用已不僅僅是輔助設(shè)計(jì)，而且可以代替人進(jìn)行某種思維。
高級EDA階段，又稱為ESDA(電子系統(tǒng)設(shè)計(jì)自動(dòng)化)系統(tǒng)。過去傳統(tǒng)的電子系統(tǒng)電子產(chǎn)品的設(shè)計(jì)方法是采用自底而上(Bottom-UP)的程式，設(shè)計(jì)者先對系統(tǒng)結(jié)構(gòu)分塊，直接進(jìn)行電路級的設(shè)計(jì)。EDA技術(shù)高級階段采用一種新的設(shè)計(jì)概念：自頂而下(TOP-Down)的設(shè)計(jì)程式和并行工程(ConcurrentEngineering)的設(shè)計(jì)方法，設(shè)計(jì)者的精力主要集中在所設(shè)計(jì)電子產(chǎn)品的準(zhǔn)確定義上，EDA系統(tǒng)去完成電子產(chǎn)品的系統(tǒng)級至物理級的設(shè)計(jì)。此階段EDA技術(shù)的主要特征是支持高級語言對系統(tǒng)進(jìn)行描述。可進(jìn)行系統(tǒng)級的仿真和綜合。
三、基于EDA技術(shù)的電子系統(tǒng)設(shè)計(jì)方法
1.電子系統(tǒng)電路級設(shè)計(jì)
首先確定設(shè)計(jì)方案，同時(shí)要選擇能實(shí)現(xiàn)該方案的合適元器件，然后根據(jù)具體的元器件設(shè)計(jì)電路原理圖。接著進(jìn)行第一次仿真，包括數(shù)字電路的邏輯模擬、故障分析、模擬電路的交直流分析和瞬態(tài)分析。系統(tǒng)在進(jìn)行仿真時(shí)，必須要有元件模型庫的支持，計(jì)算機(jī)上模擬的輸入輸出波形代替了實(shí)際電路調(diào)試中的信號源和示波器。這一次仿真主要是檢驗(yàn)設(shè)計(jì)方案在功能方面的正確性。仿真通過后，根據(jù)原理圖產(chǎn)生的電氣連接網(wǎng)絡(luò)表進(jìn)行PCB板的自動(dòng)布局布線。在制作PCB板之前還可以進(jìn)行后分析，包括熱分析、噪聲及竄擾分析、電磁兼容分析和可靠性分析等，并且可以將分析后的結(jié)果參數(shù)反標(biāo)回電路圖，進(jìn)行第二次仿真，也稱為后仿真，這一次仿真主要是檢驗(yàn)PCB板在實(shí)際工作環(huán)境中的可行性。
可見，電路級的EDA技術(shù)使電子工程師在實(shí)際的電子系統(tǒng)產(chǎn)生之前，就可以全面了解系統(tǒng)的功能特性和物理特性，從而將開發(fā)過程中出現(xiàn)的缺陷消滅在設(shè)計(jì)階段，不僅縮短了開發(fā)時(shí)間，也降低了開發(fā)成本。
2.系統(tǒng)級設(shè)計(jì)
系統(tǒng)級設(shè)計(jì)是一種“概念驅(qū)動(dòng)式”設(shè)計(jì)，設(shè)計(jì)人員無須通過門級原理圖描述電路，而是針對設(shè)計(jì)目標(biāo)進(jìn)行功能描述。由于擺脫了電路細(xì)節(jié)的束縛，設(shè)計(jì)人員可以把精力集中于創(chuàng)造性概念構(gòu)思與方案上，一旦這些概念構(gòu)思以高層次描述的形式輸入計(jì)算機(jī)后，EDA系統(tǒng)就能以規(guī)則驅(qū)動(dòng)的方式自動(dòng)完成整個(gè)設(shè)計(jì)。
系統(tǒng)級設(shè)計(jì)的步驟如下：
第一步：按照“自頂向下”的設(shè)計(jì)方法進(jìn)行系統(tǒng)劃分。
第二步：輸入VHDL代碼，這是系統(tǒng)級設(shè)計(jì)中最為普遍的輸入方式。此外，還可以采用圖形輸入方式(框圖、狀態(tài)圖等)，這種輸入方式具有直觀、容易理解的優(yōu)點(diǎn)。
第三步：將以上的設(shè)計(jì)輸入編譯成標(biāo)準(zhǔn)的VHDL文件。對于大型設(shè)計(jì)，還要進(jìn)行代碼級的功能仿真，主要是檢驗(yàn)系統(tǒng)功能設(shè)計(jì)的正確性，因?yàn)閷τ诖笮驮O(shè)計(jì)，綜合、適配要花費(fèi)數(shù)小時(shí)，在綜合前對源代碼仿真，就可以大大減少設(shè)計(jì)重復(fù)的次數(shù)和時(shí)間，一般情況下，可略去這一仿真步驟。
第四步：利用綜合器對VHDL源代碼進(jìn)行綜合優(yōu)化處理，生成門級描述的網(wǎng)表文件，這是將高層次描述轉(zhuǎn)化為硬件電路的關(guān)鍵步驟。綜合優(yōu)化是針對ASIC芯片供應(yīng)商的某一產(chǎn)品系列進(jìn)行的，所以綜合的過程要在相應(yīng)的廠家綜合庫支持下才能完成。綜合后，可利用產(chǎn)生的網(wǎng)表文件進(jìn)行適配前的時(shí)序仿真，仿真過程不涉及具體器件的硬件特性，較為粗略。一般設(shè)計(jì)，這一仿真步驟也可略去。
第五步：利用適配器將綜合后的網(wǎng)表文件針對某一具體的目標(biāo)器件進(jìn)行邏輯映射操作，包括底層器件配置、邏輯分割、邏輯優(yōu)化和布局布線。:
第六步：將適配器產(chǎn)生的器件編程文件通過編程器或下載電纜載入到目標(biāo)芯片F(xiàn)PGA或CPLD中。如果是大批量產(chǎn)品開發(fā)，通過更換相應(yīng)的廠家綜合庫，可以很容易轉(zhuǎn)由ASIC形式實(shí)現(xiàn)。
四、前景展望
21世紀(jì)將是EDA技術(shù)的高速發(fā)展時(shí)期，EDA技術(shù)是現(xiàn)代電子設(shè)計(jì)技術(shù)的發(fā)展方向，并著眼于數(shù)字邏輯向模擬電路和數(shù)?；旌想娐返姆较虬l(fā)展。EDA將會(huì)超越電子設(shè)計(jì)的范疇進(jìn)入其他領(lǐng)域隨著集成電路技術(shù)的高速發(fā)展，數(shù)字系統(tǒng)正朝著更高集成度、超小型化、高性能、高可靠性和低功耗的系統(tǒng)級芯片(SoC，SystemonChip)方向發(fā)展，借助于硬件描述語言的國際標(biāo)準(zhǔn)VHDL和強(qiáng)大的EDA工具，可減少設(shè)計(jì)風(fēng)險(xiǎn)并縮短周期，隨著VHDL語言使用范圍的日益擴(kuò)大，必將給硬件設(shè)計(jì)領(lǐng)域帶來巨大的變革。
參考文獻(xiàn)：
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eda技術(shù)論文范文第2篇
論文關(guān)鍵詞：EDA，實(shí)驗(yàn)系統(tǒng)，模塊
1 引言
隨著電子技術(shù)的發(fā)展及電子系統(tǒng)設(shè)計(jì)周期縮短的要求，EDA技術(shù)得到迅猛發(fā)展。
EDA是ElectronicDesign Automation(電子設(shè)計(jì)自動(dòng)化)的縮寫。EDA技術(shù)，就是以大規(guī)?？删幊踢壿嬈骷樵O(shè)計(jì)載體，以硬件描述語言為系統(tǒng)邏輯描述的主要表達(dá)方式，以計(jì)算機(jī)、大規(guī)?？删幊踢壿嬈骷拈_發(fā)軟件及實(shí)驗(yàn)開發(fā)系統(tǒng)為設(shè)計(jì)開發(fā)工具，通過使用有關(guān)的開發(fā)軟件，自動(dòng)完成電子系統(tǒng)設(shè)計(jì)的邏輯編譯、邏輯化簡、邏輯分割、邏輯綜合及優(yōu)化、邏輯布局布線、邏輯仿真，直至對于特定目標(biāo)芯片的適配編譯、邏輯映射、編程下載等工作，最終形成集成電子系統(tǒng)或?qū)Ｓ眉尚酒囊婚T新技術(shù)[1]。
目前，幾乎所有高校的電類專業(yè)都開設(shè)了EDA課程，為加強(qiáng)教學(xué)效果，通常都使用專門的EDA實(shí)驗(yàn)箱來輔助教學(xué)，但是實(shí)驗(yàn)箱采用了一體化結(jié)構(gòu)，所有的電路和器件都在一塊電路板上，在功能上難以根據(jù)需要進(jìn)行擴(kuò)展，不利于學(xué)生的創(chuàng)新設(shè)計(jì)，復(fù)雜系統(tǒng)難以實(shí)現(xiàn)；實(shí)驗(yàn)箱體積較大，不便攜帶；EDA 實(shí)驗(yàn)箱、單片機(jī)實(shí)驗(yàn)箱、DSP實(shí)驗(yàn)箱、ARM實(shí)驗(yàn)箱中很多功能模塊的硬件電路是相同的，但不同實(shí)驗(yàn)箱上相同模塊不能共享，存在資源浪費(fèi)。由于實(shí)驗(yàn)箱的上述缺點(diǎn)，很多高校都紛紛開始設(shè)計(jì)開發(fā)自己的實(shí)驗(yàn)系統(tǒng)模塊，提高實(shí)驗(yàn)箱的利用率，提高學(xué)生的工程創(chuàng)新能力[2][3]。
2 EDA實(shí)驗(yàn)系統(tǒng)開發(fā)的特點(diǎn)
EDA實(shí)驗(yàn)系統(tǒng)的開發(fā)具有以下特點(diǎn)：
（1）實(shí)驗(yàn)內(nèi)容由單一性向綜合性發(fā)展
早期開發(fā)的EDA實(shí)驗(yàn)系統(tǒng)主要是學(xué)生用來學(xué)習(xí)EDA課程、下載程序、進(jìn)行仿真的工具；使用實(shí)驗(yàn)系統(tǒng)是老師用來培養(yǎng)學(xué)生設(shè)計(jì)數(shù)字電路的能力、幫助學(xué)生學(xué)習(xí)和掌握開發(fā)語言的手段。因此EDA實(shí)驗(yàn)系統(tǒng)僅在電子類專業(yè)的EDA課程中使用，系統(tǒng)所提供的實(shí)驗(yàn)內(nèi)容僅限于簡單的數(shù)字電路設(shè)計(jì)，包括計(jì)數(shù)器、編碼譯碼器的設(shè)計(jì)、數(shù)碼管的顯示等。隨著EDA技術(shù)的發(fā)展，電信、通信等專業(yè)紛紛引入EDA實(shí)驗(yàn)系統(tǒng)，在“通信原理”等課程的實(shí)驗(yàn)教學(xué)中被廣泛應(yīng)用于實(shí)踐[4]，實(shí)驗(yàn)內(nèi)容也從單一的基本數(shù)字電路的設(shè)計(jì)發(fā)展到集EDA技術(shù)實(shí)驗(yàn)、單片機(jī)實(shí)驗(yàn)、DSP實(shí)驗(yàn)等為一體的綜合性的實(shí)驗(yàn)平臺(tái)[5]。因此，EDA實(shí)驗(yàn)平臺(tái)逐漸面向電子信息類相關(guān)專業(yè)的學(xué)生進(jìn)行課程的學(xué)習(xí)，課外競技活動(dòng)，電子類設(shè)計(jì)比賽，并逐漸用于教師進(jìn)行科研。
（2）系統(tǒng)結(jié)構(gòu)從一體化向模塊化發(fā)展
早起開發(fā)的EDA實(shí)驗(yàn)系統(tǒng)在結(jié)構(gòu)上采用一體化的實(shí)驗(yàn)箱設(shè)計(jì)，所有的電路和器件都在一塊電路板上[6]。這樣，系統(tǒng)的使用雖然可以幫助學(xué)生掌握軟件的應(yīng)用，但也使學(xué)生對硬件電路不了解；另外，系統(tǒng)在功能上難以根據(jù)需要進(jìn)行擴(kuò)展，不利于學(xué)生進(jìn)行創(chuàng)新設(shè)計(jì)，復(fù)雜的系統(tǒng)則難以實(shí)現(xiàn)。因此在后來的EDA實(shí)驗(yàn)系統(tǒng)的開發(fā)上，大都都采用了模塊化的結(jié)構(gòu)[7][8]，即FPGA、單片機(jī)等做在一塊核心板上，其IO口以插針形式引出，以方便和外圍電路的連接；外圍電路則以模塊的形式單獨(dú)做在不同的電路板上，比如數(shù)碼管顯示模塊、按鍵模塊、LED顯示模塊等；根據(jù)不同的實(shí)驗(yàn)摘要的模塊搭建自己設(shè)計(jì)的電路，從而提高學(xué)習(xí)興趣，增強(qiáng)實(shí)驗(yàn)教學(xué)的效果；此外，模塊化的設(shè)計(jì)還方便老師對學(xué)生設(shè)計(jì)的重復(fù)實(shí)現(xiàn)，有利于教學(xué)水平的提高雜志鋪。
（3）核心芯片由單一化向豐富化發(fā)展
早期開發(fā)的EDA實(shí)驗(yàn)系統(tǒng)由于僅用于EDA課程的學(xué)習(xí)，其核心芯片大都為Altera公司的FPGA等可編程邏輯器件，開發(fā)語言環(huán)境主要為界面友好、操作簡便的Maxplus Ⅱ和Quartus Ⅱ。隨著EDA技術(shù)向不同學(xué)科不同專業(yè)的滲透，核心芯片逐漸發(fā)展為FPGA、單片機(jī)和DSP器件的綜合使用，開發(fā)語言也逐漸開始使用C語言或匯編語言等。這樣，實(shí)驗(yàn)系統(tǒng)能提供的實(shí)驗(yàn)內(nèi)容和規(guī)模均有所增加，除了基本的數(shù)字電路設(shè)計(jì)實(shí)驗(yàn)?zāi)K以外，還可以增設(shè)調(diào)制解調(diào)模塊、幀同步模塊、信號波形產(chǎn)生模塊等，擴(kuò)大了實(shí)驗(yàn)系統(tǒng)的使用率，使實(shí)驗(yàn)設(shè)備向大型化、先進(jìn)化發(fā)展。
（4）使學(xué)生的學(xué)習(xí)由被動(dòng)向主動(dòng)發(fā)展
電子技術(shù)的發(fā)展日新月異，早期的實(shí)驗(yàn)平臺(tái)由于其電路設(shè)計(jì)的封閉性，實(shí)驗(yàn)內(nèi)容只停留在驗(yàn)證實(shí)驗(yàn)上，很難加入自己設(shè)計(jì)的外圍電路。而模塊化數(shù)字電路開放實(shí)驗(yàn)平臺(tái)由于其接口電路的開放性，有能力的學(xué)生可以自行設(shè)計(jì)外圍電路達(dá)到提高的目的，對于成功的設(shè)計(jì)還可以加到以后的實(shí)驗(yàn)教學(xué)中，成為具有自主知識產(chǎn)權(quán)的模塊。
另外，由于整合了單片機(jī)、DSP等芯片的功能模塊，實(shí)驗(yàn)內(nèi)容得到很大擴(kuò)展，學(xué)生在實(shí)驗(yàn)過程中可以拓寬知識面，主動(dòng)去學(xué)習(xí)了解實(shí)驗(yàn)所需要的知識，學(xué)習(xí)的主動(dòng)性得到很大的提高，并且，由于實(shí)驗(yàn)由簡單的驗(yàn)證實(shí)驗(yàn)向綜合的大型設(shè)計(jì)過渡，學(xué)生在實(shí)驗(yàn)過程中更容易理解數(shù)字電路設(shè)計(jì)中硬件的概念以及工程的概念。
學(xué)生在設(shè)計(jì)實(shí)驗(yàn)時(shí)，可能會(huì)用到一些實(shí)驗(yàn)系統(tǒng)沒有開發(fā)出的模塊，這時(shí)，學(xué)生需要自己設(shè)計(jì)該電路模塊的電路圖以及制作PCB板，直至實(shí)際制作出該功能模塊。這樣，學(xué)生除了掌握編程、還需要去學(xué)習(xí)怎樣設(shè)計(jì)并制作電路板、學(xué)習(xí)該模塊與核心板的接口電路設(shè)計(jì)等相關(guān)知識，因此，在實(shí)驗(yàn)過程中，學(xué)生的積極性和主動(dòng)性得到提高。同時(shí)，由于實(shí)驗(yàn)的規(guī)模逐漸增加，同學(xué)之間需要團(tuán)結(jié)合作才能共同完成一個(gè)實(shí)驗(yàn)，因此也鍛煉了同學(xué)之間的團(tuán)結(jié)合作精神。
3 結(jié)論
一個(gè)好的EDA實(shí)驗(yàn)平臺(tái)，能培養(yǎng)學(xué)生開拓創(chuàng)新精神和團(tuán)結(jié)協(xié)作精神、很強(qiáng)的實(shí)踐操作能力、工程設(shè)計(jì)能力、綜合應(yīng)用能力、科學(xué)研究能力以及獨(dú)立分析問題和解決問題的能力。我國高校現(xiàn)階段所研制開發(fā)的EDA綜合實(shí)驗(yàn)平臺(tái)，能有效整合和優(yōu)化多個(gè)電子類實(shí)驗(yàn)課程的功能，為單片機(jī)和 EDA技術(shù)等課程提供了綜合實(shí)驗(yàn)平臺(tái)，為高校培養(yǎng)創(chuàng)新性人才提供良好的實(shí)驗(yàn)條件和氛圍。隨著電子技術(shù)的發(fā)展以及EDA技術(shù)的不斷深入發(fā)展，EDA實(shí)驗(yàn)平臺(tái)的開發(fā)也將會(huì)日益完善：大規(guī)模可編程器件將被使用；實(shí)驗(yàn)系統(tǒng)將向體積小、功耗小的便攜式嵌入式系統(tǒng)發(fā)展。
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eda技術(shù)論文范文第3篇
隨著大規(guī)模集成電路技術(shù)和計(jì)算機(jī)技術(shù)的不斷發(fā)展，在涉及通信、國防、航天、醫(yī)學(xué)、工業(yè)自動(dòng)化、計(jì)算機(jī)應(yīng)用、儀器儀表等領(lǐng)域的電子系統(tǒng)設(shè)計(jì)工作中EDA技術(shù)的含量正以驚人的速度上升；電子類的高新技術(shù)項(xiàng)目的開發(fā)也逾益依賴于EDA技術(shù)的應(yīng)用。即使是普通的電子產(chǎn)品的開發(fā)EDA技術(shù)常常使一些原來的技術(shù)瓶頸得以輕松突破從而使產(chǎn)品的開發(fā)周期大為收縮、性能價(jià)格比大幅提高。不言而喻EDA技術(shù)將迅速成為電子設(shè)計(jì)領(lǐng)域中的極其重要的組成部分。
100Hz頻率計(jì)數(shù)器的主要功能是在一定時(shí)間內(nèi)對頻率的計(jì)算。在數(shù)字系統(tǒng)中，計(jì)數(shù)器可以統(tǒng)計(jì)輸入脈沖的個(gè)數(shù)，實(shí)現(xiàn)計(jì)時(shí)、計(jì)數(shù)、分頻、定時(shí)、產(chǎn)生節(jié)拍脈沖和序列脈沖。而本篇論文主要介紹了頻率計(jì)數(shù)器的實(shí)現(xiàn):系統(tǒng)以MAX+PULSLLII為開發(fā)環(huán)境，通過VHDL語言作為硬件描述語言實(shí)現(xiàn)對電路結(jié)構(gòu)的描述。在VHDL語言中采用了一系列的語句,例如:if語句、case語句、loop語句等。這些語句對程序中的輸入輸出端口進(jìn)行了解釋,并給出實(shí)現(xiàn)代碼和仿真波形。相關(guān)的一些關(guān)鍵詞：100Hz；分頻；計(jì)數(shù)；MAX+PULSLLII；VHDL；編譯；仿真等。
前言
VHDL是超高速集成電路硬件描述語言（VeryHighSpeedIntegratedCircuitHardwareDescriptionLanguage）的縮寫在美國國防部的支持下于1985年正式推出是目前標(biāo)準(zhǔn)化程度最高的硬件描述語言。IEEE（TheInstituteofElectricalandElectronicsEngineers）于1987年將VHDL采納為IEEE1076標(biāo)準(zhǔn)。它經(jīng)過十幾年的發(fā)展、應(yīng)用和完善以其強(qiáng)大的系統(tǒng)描述能力、規(guī)范的程序設(shè)計(jì)結(jié)構(gòu)、靈活的語言表達(dá)風(fēng)格和多層次的仿真測試手段在電子設(shè)計(jì)領(lǐng)域受到了普遍的認(rèn)同和廣泛的接受成為現(xiàn)代EDA領(lǐng)域的首選硬件描述語言。目前流行的EDA工具軟件全部支持VHDL它在EDA領(lǐng)域的學(xué)術(shù)交流、電子設(shè)計(jì)的存檔、專用集成電路（ASIC）設(shè)計(jì)等方面擔(dān)任著不可缺少的角色。
數(shù)字頻率計(jì)是數(shù)字電路中的一個(gè)典型應(yīng)用，實(shí)際的硬件設(shè)計(jì)用到的器件較多，連線比較復(fù)雜，而且會(huì)產(chǎn)生比較大的延時(shí)，造成測量誤差、可靠性差。隨著復(fù)雜可編程邏輯器件（CPLD）的廣泛應(yīng)用，以EDA工具作為開發(fā)手段，運(yùn)用VHDL語言。將使整個(gè)系統(tǒng)大大簡化。提高整體的性能和可靠性。
本文用VHDL在CPLD器件上實(shí)現(xiàn)一種2b數(shù)字頻率計(jì)測頻系統(tǒng)，能夠用十進(jìn)制數(shù)碼顯示被測信號的頻率，不僅能夠測量正弦波、方波和三角波等信號的頻率，而且還能對其他多種物理量進(jìn)行測量。具有體積小、可靠性高、功耗低的特點(diǎn)。
目錄
摘要………………………………………………………………………1
前言……………………………………………………………………2
目錄……………………………………………………………………3
第一章設(shè)計(jì)目的………………………………………………………5
1.1設(shè)計(jì)要求……………………………………………………5
1.2設(shè)計(jì)意義……………………………………………………5
第二章設(shè)計(jì)方案………………………………………………………6
第三章產(chǎn)生子模塊……………………………………………………7
3.1分頻模塊……………………………………………………7
3.2分頻模塊源代碼………………………………………………8
3.3仿真及波形圖…………………………………………………9
第四章計(jì)數(shù)模塊………………………………………………………9
4.1．計(jì)數(shù)模塊分析…………………………………………………9
4.2．計(jì)數(shù)模塊源代碼………………………………………………10
4.3計(jì)數(shù)模塊的仿真及波形圖……………………………………12
第五章顯示模塊……………………………………………………12
5.1七段數(shù)碼管的描述……………………………………………13
5.2八進(jìn)制計(jì)數(shù)器count8的描述…………………………………14
5.3七段顯示譯碼電路的描述……………………………………15
5.4計(jì)數(shù)位選擇電路的描述………………………………………16
5.5總體功能描述……………………………………………18
5.6顯示模塊的仿真及波形圖………………………………19
第六章頂層文件…………………………………………………20
6.1頂層文件設(shè)計(jì)源程序…………………………………………20
6.2頂層文件的仿真及波形圖………………………………………21
結(jié)語…………………………………………………………22
參考文獻(xiàn)……………………………………………………23
致謝…………………………………………………………24
附件…………………………………………………………25
第一章設(shè)計(jì)目的
1.1設(shè)計(jì)要求
a.獲得穩(wěn)定100Hz頻率
b.用數(shù)碼管的顯示
c.用VHDL寫出設(shè)計(jì)整個(gè)程序
1.2設(shè)計(jì)意義
a.進(jìn)一步學(xué)習(xí)VHDL硬件描述語言的編程方法和步驟。
b.運(yùn)用VHDL硬件描述語言實(shí)現(xiàn)對電子元器件的功能控制
c.熟悉并掌握元件例化語句的使用方法
d.熟悉數(shù)字式頻率的基本工作原理。
eda技術(shù)論文范文第4篇
【關(guān)鍵詞】數(shù)字電路課程；實(shí)踐平臺(tái)；工程設(shè)計(jì)；實(shí)驗(yàn)
1概述
在教學(xué)過程中，具備數(shù)字系統(tǒng)設(shè)計(jì)實(shí)踐工程能力，涉及相關(guān)數(shù)字系統(tǒng)課程體系教學(xué)與實(shí)踐，在各高校的電氣、電子信息類專業(yè)中，數(shù)字電路是一門專業(yè)基礎(chǔ)課程，隨著數(shù)字技術(shù)應(yīng)用領(lǐng)域的不斷擴(kuò)大，在后續(xù)專業(yè)課程中，顯而易見，隨著電子產(chǎn)品數(shù)字化部分比重增大，它在數(shù)字系統(tǒng)設(shè)計(jì)中基礎(chǔ)性地位越來越突出。
因此，培養(yǎng)適合現(xiàn)代電氣、電子、信息技術(shù)發(fā)展的卓越人才，創(chuàng)新數(shù)字電路的課程幾次理論與工程實(shí)踐教學(xué)迫在眉睫。
根據(jù)我校近幾年電氣、電子課堂教學(xué)的實(shí)踐情況，數(shù)字電路課程應(yīng)該以面向應(yīng)用的數(shù)字電路設(shè)計(jì)為核心，在熟練掌握基本電路教學(xué)內(nèi)容的基礎(chǔ)上引入先進(jìn)的數(shù)字系統(tǒng)設(shè)計(jì)方法的課程教學(xué)和實(shí)踐內(nèi)容。
工程實(shí)踐過程中，逐步從自底向上的設(shè)計(jì)方法逐步轉(zhuǎn)變到自頂向下的設(shè)計(jì)方法中來，以教師科研應(yīng)用來拓展，以全面培養(yǎng)優(yōu)秀數(shù)字設(shè)計(jì)卓越技術(shù)人才[1]。
2探索構(gòu)建數(shù)字電路教學(xué)中的多層次的創(chuàng)新實(shí)踐平臺(tái)
2.1多層次的數(shù)字電路創(chuàng)新實(shí)驗(yàn)平臺(tái)構(gòu)思。
面向卓越人才培養(yǎng)的數(shù)字電路課程創(chuàng)新實(shí)踐教學(xué)，可以分層次進(jìn)行在各個(gè)教學(xué)階段逐步推進(jìn)，包括：面向基礎(chǔ)的數(shù)字設(shè)計(jì)的基本原理與工程創(chuàng)新實(shí)驗(yàn)教學(xué)模塊、面向應(yīng)用的數(shù)字電路課程設(shè)計(jì)教學(xué)和結(jié)合科研項(xiàng)目的創(chuàng)新實(shí)踐平臺(tái)[2][6]。
多層次的數(shù)字電路創(chuàng)新實(shí)驗(yàn)平臺(tái)架構(gòu)如圖1所示。
2.2數(shù)字設(shè)計(jì)的基礎(chǔ)原理與實(shí)驗(yàn)教學(xué)。
數(shù)字電路基礎(chǔ)原理和實(shí)驗(yàn)教學(xué)是數(shù)字系統(tǒng)設(shè)計(jì)的課程體系的基礎(chǔ)入門階段，是培養(yǎng)數(shù)字邏輯代數(shù)與邏輯電路的重要過程，大類可分為時(shí)序邏輯電路和組合邏輯電路，其中時(shí)序邏輯電路主要包括：鎖存器、觸發(fā)器和計(jì)數(shù)器，組合邏輯電路包括，編譯碼器、多路復(fù)用器、比較器、加（減）法器、數(shù)值比較器和算術(shù)邏輯單元等。教學(xué)的目的是訓(xùn)練學(xué)生掌握組合和時(shí)序邏輯電路堅(jiān)實(shí)理論基礎(chǔ)，使學(xué)生掌握數(shù)字電路的基本概念、基本電路、基本分析方法和基本實(shí)驗(yàn)技能，不但要注重基本數(shù)字電路與系統(tǒng)設(shè)計(jì)理論的理解，同時(shí)讓學(xué)生在學(xué)習(xí)中逐步了解面向應(yīng)用和現(xiàn)代科技進(jìn)步數(shù)字電路新的設(shè)計(jì)理念[2][3]。
2.3面向應(yīng)用的數(shù)字電路課程設(shè)計(jì)實(shí)踐教學(xué)。
隨著電子設(shè)計(jì)自動(dòng)化技術(shù)（EDA）和可編程器件（CPLD）的不斷發(fā)展和應(yīng)用，以EDA技術(shù)為主導(dǎo)的數(shù)字系統(tǒng)理念已經(jīng)成為企業(yè)工程技術(shù)的核心。數(shù)字電路課程設(shè)計(jì)主要培養(yǎng)學(xué)生利用中小規(guī)模數(shù)字集成電路器件和大規(guī)?？删幊唐骷M(jìn)行數(shù)字電路設(shè)計(jì)和開發(fā)能力。在卓越工程師培養(yǎng)背景下，結(jié)合前階段數(shù)字電路課程理論教學(xué)和實(shí)驗(yàn)教學(xué)的實(shí)際情況及EDA技術(shù)的發(fā)展?fàn)顩r，適時(shí)進(jìn)行數(shù)字電路課程設(shè)計(jì)和EDA技術(shù)課程的綜合銜接，以及課程深度融合[4]。主要內(nèi)容包括：
2.3.1基于Multisim等相關(guān)軟件的數(shù)字系統(tǒng)仿真實(shí)驗(yàn)?？梢詷?gòu)建虛擬數(shù)字實(shí)驗(yàn)系統(tǒng)，不但較好地模擬實(shí)物外觀外，還可以利用系統(tǒng)提供的實(shí)驗(yàn)平臺(tái)開展實(shí)驗(yàn)的設(shè)計(jì)、仿真，進(jìn)行實(shí)驗(yàn)內(nèi)容的邏輯驗(yàn)證。
2.3.2基于通用和專用數(shù)字芯片的數(shù)字系統(tǒng)設(shè)計(jì)。其主要特點(diǎn)是有很好的直觀性和具體性。
2.3.3基于硬件描述語言（HDL）的數(shù)學(xué)系統(tǒng)硬件描述。采用硬件描述語言實(shí)現(xiàn)數(shù)字邏輯設(shè)計(jì)，基于EDA環(huán)境仿真和驗(yàn)證?？梢越Y(jié)合上述（1）和（2）的優(yōu)點(diǎn)，采用硬件設(shè)計(jì)軟件化技術(shù)應(yīng)用于數(shù)字電路課程設(shè)計(jì)的實(shí)驗(yàn)教學(xué)中，通過綜合性實(shí)驗(yàn)的自行設(shè)計(jì)和實(shí)驗(yàn)，對實(shí)驗(yàn)內(nèi)容、實(shí)驗(yàn)規(guī)模、實(shí)驗(yàn)方法進(jìn)行了綜合創(chuàng)新設(shè)計(jì)[5]。
2.4結(jié)合科研項(xiàng)目的數(shù)字設(shè)計(jì)實(shí)驗(yàn)創(chuàng)新平臺(tái)。
在高等院校，教師即承擔(dān)教學(xué)任務(wù)，同時(shí)有各自的科學(xué)研究方向，同學(xué)們可以根據(jù)自己的研究興趣，加入教師的科研團(tuán)隊(duì)，形成教學(xué)與科研互利的良性循環(huán)。面向卓越工程師培養(yǎng)的數(shù)字系統(tǒng)設(shè)計(jì)，可以借助橫向或縱向科研項(xiàng)目形成綜合教學(xué)體系。比如：搭建在線可編程門陣列（FPGA）創(chuàng)新實(shí)驗(yàn)平臺(tái)，形成數(shù)字電路、電路線路課程設(shè)計(jì)、可編程邏輯器件以及集成芯片系統(tǒng)設(shè)計(jì)，形成面向數(shù)字系統(tǒng)設(shè)計(jì)的課程體系[3]。同時(shí)，應(yīng)用高校與知名企業(yè)建立的校企合作平臺(tái)，把企業(yè)界的研究信息和研發(fā)需求引入到教學(xué)平臺(tái)，開拓了學(xué)生的研究思路和視野，提升了學(xué)生設(shè)計(jì)復(fù)雜數(shù)字系統(tǒng)的能力；目前，我校正在與國際知名的半導(dǎo)體公司Xilinx、Altera和Cypress陸續(xù)建立卓越人才大學(xué)培養(yǎng)計(jì)劃，利用大學(xué)設(shè)置小學(xué)期，在FPGA和PSoC開發(fā)平臺(tái)上進(jìn)行了面向?qū)嶋H應(yīng)用的數(shù)字系統(tǒng)設(shè)計(jì)，在實(shí)踐平臺(tái)上不僅有學(xué)校的任課教師，還有知名企業(yè)派來的一線工程師指導(dǎo)同學(xué)們的實(shí)踐，相比改革前，取得很好的實(shí)踐效果，同學(xué)們的數(shù)字系統(tǒng)設(shè)計(jì)水平得到了提高，同時(shí)在編程、接口、通信協(xié)議等方面也有了深刻的認(rèn)識。
對于優(yōu)秀的學(xué)生，借助全國各種形式的大學(xué)生電子（信息）設(shè)計(jì)競賽這個(gè)創(chuàng)新平臺(tái)，組織他們積極參與，激發(fā)他們的學(xué)習(xí)研究興趣和創(chuàng)新意識，綜合所應(yīng)用的數(shù)字系統(tǒng)設(shè)計(jì)知識，發(fā)揮競賽團(tuán)隊(duì)的協(xié)作精神。每年，我們都有部分優(yōu)秀學(xué)生通過努力，創(chuàng)新設(shè)計(jì)的作品獲得專業(yè)認(rèn)可，并取得了良好的參賽成績，也使得數(shù)字設(shè)計(jì)課程體系的建設(shè)上了一個(gè)新的臺(tái)階。
3基于創(chuàng)新平臺(tái)的課程體系優(yōu)化與實(shí)踐
卓越工程師培養(yǎng)要求的數(shù)字電路系統(tǒng)設(shè)計(jì)課程體系協(xié)調(diào)好相關(guān)電氣、電子類專業(yè)上下游相關(guān)理論課程、實(shí)驗(yàn)綜合性設(shè)計(jì)同時(shí)得到協(xié)調(diào)發(fā)展。如何實(shí)踐論文所提到的創(chuàng)新實(shí)驗(yàn)平臺(tái)，應(yīng)該引進(jìn)現(xiàn)代數(shù)字設(shè)計(jì)理念，重點(diǎn)把EDA軟件、設(shè)計(jì)工具、開發(fā)平臺(tái)與傳統(tǒng)的數(shù)字電路基礎(chǔ)理論教學(xué)相銜接。我們在這幾年對數(shù)字系統(tǒng)設(shè)計(jì)課程體系、創(chuàng)新實(shí)踐教學(xué)內(nèi)容等方面的進(jìn)行了改革與探索，取得了一定的成效。經(jīng)過這幾年的實(shí)踐，我們逐步構(gòu)建了面向應(yīng)用的數(shù)字系統(tǒng)設(shè)計(jì)課程優(yōu)化體系[5]，如圖2所示。
4不斷探索數(shù)字電路理論教學(xué)內(nèi)容的改革與實(shí)踐
4.1以數(shù)字電路設(shè)計(jì)為目的強(qiáng)化基本邏輯電路理論教學(xué)。
在進(jìn)行復(fù)雜數(shù)字系統(tǒng)設(shè)計(jì)之前應(yīng)該熟練掌握這些常用基本組合和時(shí)序邏輯電路，包括電路的功能、電路的描述以及電路的應(yīng)用場合等。
樹立電路設(shè)計(jì)思想首先需要熟練掌握一些基本的邏輯功能電路。其次，樹立電路設(shè)計(jì)思想需要理論講解與實(shí)踐相結(jié)合，逐步熟悉硬件描述語言的描述方式。數(shù)字系統(tǒng)設(shè)計(jì)強(qiáng)調(diào)采用硬件描述語言來對電路與系統(tǒng)進(jìn)行描述、建模、仿真等[2][3]。
4.2掌握面向應(yīng)用的數(shù)字系統(tǒng)工程設(shè)計(jì)方法。
學(xué)生在掌握數(shù)字電路基本概念和一般電路的基礎(chǔ)上，進(jìn)一步掌握數(shù)字系統(tǒng)設(shè)計(jì)的方法、途徑和手段。其主要內(nèi)容包括：數(shù)字系統(tǒng)與EDA的相關(guān)概念、可編程邏輯器件、硬件描述語言、電路元件的描述、數(shù)字系統(tǒng)的設(shè)計(jì)方法、開發(fā)環(huán)境與實(shí)驗(yàn)開發(fā)平臺(tái)以及應(yīng)用實(shí)例的介紹等。這些課程內(nèi)容涉及面較廣，為了提高教與學(xué)的效果，探索總結(jié)了以下的教學(xué)重點(diǎn)內(nèi)容，并作為教學(xué)實(shí)踐中的教學(xué)切入點(diǎn)[1]。
隨著電子技術(shù)不斷發(fā)展與進(jìn)步，現(xiàn)代數(shù)字系統(tǒng)設(shè)計(jì)在方法、對象、規(guī)模等方面已經(jīng)完全不同于傳統(tǒng)的基于固定功能的集成電路設(shè)計(jì)[1][2]?，F(xiàn)代數(shù)字系統(tǒng)設(shè)計(jì)采用硬件描述語言（HDL）描述電路，用可編程邏輯器件（PLD）來實(shí)現(xiàn)高達(dá)千萬門的目標(biāo)系統(tǒng)。這一過程需要也應(yīng)該有先進(jìn)的設(shè)計(jì)方法。根據(jù)硬件描述語言的特性和可編程邏輯器件的結(jié)構(gòu)特點(diǎn)以及應(yīng)用的需要，在教學(xué)過程中闡述了先進(jìn)設(shè)計(jì)方法。例如：采用基于狀態(tài)機(jī)的設(shè)計(jì)方法設(shè)計(jì)復(fù)雜的控制器（時(shí)序電路），應(yīng)用或設(shè)計(jì)鎖相環(huán)或延時(shí)鎖相環(huán)來處理時(shí)鐘信號，應(yīng)用自行設(shè)計(jì)（IPcore）軟核來提高數(shù)據(jù)吞吐量[1][2][3]。
4.3深化數(shù)字電路實(shí)驗(yàn)教學(xué)改革。
實(shí)驗(yàn)實(shí)踐教學(xué)過程中，注重基礎(chǔ)訓(xùn)練與實(shí)踐創(chuàng)新相結(jié)合的實(shí)驗(yàn)教學(xué)改革思路，加強(qiáng)學(xué)生工程思維訓(xùn)練、新平臺(tái)工具的使用、遇到邏輯問題的綜合分析能力，理論與實(shí)踐相結(jié)合的分析能力。在實(shí)踐過程中的提高創(chuàng)新性和綜合性能力，面向應(yīng)用的數(shù)字電路創(chuàng)新平臺(tái)建設(shè)，需要不斷提高課程試驗(yàn)、實(shí)驗(yàn)和實(shí)踐過程在教學(xué)中的比例，在符合認(rèn)知規(guī)律的同時(shí)，逐步加強(qiáng)來源與實(shí)際需要的綜合性數(shù)字設(shè)計(jì)實(shí)驗(yàn)。
5結(jié)語
數(shù)字電路是電氣、電子信息類專業(yè)的一門重要的專業(yè)基礎(chǔ)課程，論文針對當(dāng)今卓越工程師培養(yǎng)的要求，以及在教學(xué)過程中遇到的主要問題，探討了面向應(yīng)用的數(shù)字電路課程創(chuàng)新實(shí)踐平臺(tái)。提出了多層次的數(shù)字電路創(chuàng)新實(shí)驗(yàn)平臺(tái)結(jié)構(gòu)和面向應(yīng)用的數(shù)字系統(tǒng)設(shè)計(jì)課程優(yōu)化體系。目的在于，通過課程及相關(guān)課程體系改革與創(chuàng)新，使得學(xué)生更快、更好的適應(yīng)現(xiàn)代數(shù)字技術(shù)發(fā)展的需求。
參考文獻(xiàn)
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eda技術(shù)論文范文第5篇
關(guān)鍵詞：獨(dú)立學(xué)院嵌入式課程設(shè)置課程改革優(yōu)化
中圖分類號：G423.04
引言
以我校（武漢長江工商學(xué)院）為例，電子信息工程專業(yè)主要培養(yǎng)能在信息通信、電子技術(shù)、智能控制、計(jì)算機(jī)與網(wǎng)絡(luò)等領(lǐng)域和行政部門從事各類電子設(shè)備和信息系統(tǒng)的科學(xué)研究、產(chǎn)品設(shè)計(jì)、工藝制造、應(yīng)用開發(fā)和技術(shù)管理的應(yīng)用型工程技術(shù)人才，因此，我們以培養(yǎng)應(yīng)用型人才為目標(biāo)制定了培養(yǎng)方案。
課程設(shè)置現(xiàn)狀
在我們的培養(yǎng)方案中，除了專業(yè)基礎(chǔ)課程（C語言程序設(shè)計(jì)、電路分析、電工基礎(chǔ)、數(shù)字電路、模擬電路）外，有兩條主線：嵌入式方向與信號處理方向。其它方向如微電子、射頻、無線電等方向，考慮到我們學(xué)生的基礎(chǔ)以及培養(yǎng)方案總課時(shí)的要求，最終選擇了嵌入式與信號處理兩個(gè)方向，當(dāng)然，隨著社會(huì)的不斷發(fā)展，以后的培養(yǎng)方案可能會(huì)考慮微電子等較新的方向。
之所以選擇嵌入式硬件方向?yàn)槲覀兊囊粭l主線是因?yàn)榍度胧较到y(tǒng)是當(dāng)前很熱門而且很有發(fā)展前景并且對于學(xué)生而言也是比較好就業(yè)的應(yīng)用領(lǐng)域之一。嵌入式系統(tǒng)在智能化家居、家電，汽車電子、醫(yī)療、交通等各個(gè)方面都有應(yīng)用，我們的生活已經(jīng)離不開嵌入式系統(tǒng)。嵌入式系統(tǒng)是軟硬結(jié)合的技術(shù)，我們以硬件設(shè)計(jì)為主設(shè)置了我們的課程如下：
表1：嵌入式方向的課程設(shè)置
圍繞ARM嵌入式技術(shù)這門課，還有微機(jī)原理、單片機(jī)、EDA、DSP等課程及相關(guān)實(shí)驗(yàn)。
學(xué)習(xí)了微機(jī)原理和單片機(jī)這兩門課后再學(xué)習(xí)嵌入式，學(xué)生更容易入門，因?yàn)榍度胧奖旧硎菑膯纹瑱C(jī)發(fā)展而來，并且在微機(jī)原理與單片機(jī)這兩門課程中，我們以匯編指令為主，主要是考慮到做嵌入式系統(tǒng)除了了解ARM處理器工作原理和接口技術(shù)還要了解ARM的匯編指令系統(tǒng)。
考慮到嵌入式開發(fā)的發(fā)展方向與相關(guān)領(lǐng)域，我們還設(shè)置了EDA技術(shù)與DSP技術(shù)兩門課。數(shù)字圖像壓縮技術(shù)是嵌入式的應(yīng)用領(lǐng)域之一，主要是掌握MPEG編解碼算法和技術(shù)和DSP技術(shù)，另外，為追求更高速的信號處理速度，現(xiàn)在一些速度要求較高場合，有不少公司是將一些DSP算法用硬件來實(shí)現(xiàn)，這就涉及到HDL數(shù)字電路設(shè)計(jì)技術(shù)及其FPGA/IP核實(shí)現(xiàn)技術(shù)。這也是我們將EDA技術(shù)與DSP技術(shù)這兩門課作為這個(gè)方向的專業(yè)課程的原因。
課程改革思路
首先是微機(jī)原理與單片機(jī)這兩門課，目前我們開設(shè)《微機(jī)原理與接口技術(shù)》理論課54課時(shí)，實(shí)驗(yàn)課18課時(shí)，《單片機(jī)原理及其應(yīng)用》理論課54課時(shí)，實(shí)驗(yàn)課18課時(shí)，課程設(shè)計(jì)36課時(shí)。微機(jī)原理課程主要是幫助學(xué)生理解一款微型計(jì)算機(jī)的工作原理、結(jié)構(gòu)、匯編語言編程及其接口電路，為以后的進(jìn)一步學(xué)習(xí)不同的CPU以及計(jì)算機(jī)應(yīng)用打下基礎(chǔ)。目前我們的教學(xué)還是以8086/8088作為微機(jī)原理主講芯片，其難度較大，與實(shí)驗(yàn)教學(xué)和學(xué)生在課外的實(shí)際應(yīng)用（如參加電子設(shè)計(jì)系列競賽、制作小作品、畢業(yè)論文、課程設(shè)計(jì)等）脫節(jié)，教學(xué)效果不理想。
隨著半導(dǎo)體技術(shù)的進(jìn)步，處理器從單核時(shí)代進(jìn)步到了多核時(shí)代，并且將來處理核的數(shù)目將會(huì)越來越多。隨著多核技術(shù)的發(fā)展，可能不久的將來大多數(shù)的軟件開發(fā)都將以多核芯片為基礎(chǔ)硬件平臺(tái)，隨之而來的是編程語言、數(shù)據(jù)結(jié)構(gòu)、算法理論、軟件工程等都將隨著多核的出現(xiàn)而進(jìn)行修訂，對我們專業(yè)而言，要考慮的主要是計(jì)算機(jī)硬件方向的課程設(shè)置要進(jìn)行調(diào)整以適應(yīng)多核時(shí)代的到來。經(jīng)過調(diào)研與研討，我們決定將上述兩門課整合優(yōu)化為《單片機(jī)原理與接口技術(shù)》54課時(shí)及《多核架構(gòu)與編程技術(shù)》54課時(shí)。前瞻性的將多核架構(gòu)及編程技術(shù)引入到獨(dú)立學(xué)院電子信息工程本科培養(yǎng)方案中，將培養(yǎng)方案中的專業(yè)基礎(chǔ)知識進(jìn)行綜合與升華，幫助學(xué)生，順應(yīng)市場格局變化，接受新技術(shù)新理念，建立系統(tǒng)、完整的專業(yè)基礎(chǔ)理論體系，培養(yǎng)學(xué)生綜合應(yīng)用能力與創(chuàng)新型思維，提高動(dòng)手實(shí)踐能力，開拓學(xué)生的專業(yè)學(xué)術(shù)視野。使我們的學(xué)生能順應(yīng)時(shí)代的變化，在硬件、軟件方面能夠更好地了解多核思想及編程技術(shù)，以適應(yīng)高新技術(shù)的飛速發(fā)展的需要。
其次是EDA技術(shù)與數(shù)字電路的整合。目前我們開設(shè)《EDA技術(shù)》理論課34課時(shí)，實(shí)驗(yàn)課18課時(shí)，課程設(shè)計(jì)18課時(shí)，《數(shù)字電路》理論課54課時(shí)，實(shí)驗(yàn)課18課時(shí)，課程設(shè)計(jì)36課時(shí)。這兩門課在實(shí)驗(yàn)和課程設(shè)計(jì)的內(nèi)容上有一定的重復(fù)。我們可以將這兩門課整合成一門課《數(shù)字電路與VHDL》，理論課72，實(shí)驗(yàn)課18，課程設(shè)計(jì)36課時(shí)，改變原有的教學(xué)模式和教學(xué)內(nèi)容，建立新的實(shí)驗(yàn)體系，讓學(xué)生感受2種不同的設(shè)計(jì)方法，擺脫傳統(tǒng)的人工設(shè)計(jì)方法與思維模式，提高學(xué)生的創(chuàng)新意識與競爭能力，適應(yīng)市場的需要。
最后是ARM嵌入式技術(shù)，目前我們以ARM7進(jìn)行理論教學(xué)，以LPC2000系列ARM7微控制器及ADS1.2集成開發(fā)環(huán)境進(jìn)行實(shí)驗(yàn)，理論課36學(xué)時(shí)，實(shí)驗(yàn)課18學(xué)時(shí)，只能滿足低端教學(xué)任務(wù)。在最初制定教學(xué)計(jì)劃，大部分ARM系統(tǒng)都是基于ARM7處理器，但是隨著更多應(yīng)用在嵌入式系統(tǒng)中的實(shí)現(xiàn)，嵌入式系統(tǒng)設(shè)計(jì)向著更高級、更復(fù)雜的方向發(fā)展，現(xiàn)在基于ARM9處理器的產(chǎn)品越來越多，我們的教學(xué)要與時(shí)俱進(jìn)，教學(xué)內(nèi)容也要進(jìn)行升級為以ARM9進(jìn)行教學(xué)。從ARM體系結(jié)構(gòu)的教學(xué)內(nèi)容上看，ARM9的指令集完全兼ARM7，教學(xué)上沒有任何區(qū)別。并且學(xué)生們面對的編程模型和架構(gòu)基礎(chǔ)也保持一致。
總結(jié)
本校電子信息工程專業(yè)實(shí)行3+1培養(yǎng)模式，所有課程安排在大一到大三完成，大四學(xué)生全部參加實(shí)習(xí)，現(xiàn)有培養(yǎng)方案中，專業(yè)基礎(chǔ)課排在第三、四學(xué)期，專業(yè)課基本壓縮在第五、六學(xué)期，比如上面提到的微機(jī)原理安排在第五學(xué)期，單片機(jī)、EDA技術(shù)、ARM嵌入式技術(shù)安排在第六學(xué)期。通常在第六學(xué)期，一部分學(xué)生忙于考研，一部分學(xué)生忙于找工作，精力沒有全部用于學(xué)習(xí)專業(yè)知識上，但是，經(jīng)過上面的整合后，我們可以將單片機(jī)以及ARM嵌入式技術(shù)提前一個(gè)學(xué)期，再將EDA技術(shù)提前兩學(xué)期，讓學(xué)生們在整個(gè)大學(xué)的學(xué)習(xí)過程中，盡早的接觸到專業(yè)課程，提高學(xué)生們的學(xué)習(xí)興趣，這不僅可以讓一部分想?yún)⒓与娮釉O(shè)計(jì)系列競賽的同學(xué)可以盡早的進(jìn)行系統(tǒng)學(xué)習(xí)，也可以讓準(zhǔn)備考研和找工作的同學(xué)投入更多精力學(xué)習(xí)專業(yè)知識。
參考文獻(xiàn)
- eda技術(shù)論文